PLLのブロック図中のa~cに入れるべき回路の組合せとして、適切なものはどれか。

PLLは位相比較器・LPF・VCOと帰還分周器で構成される

エンベデッドシステムスペシャリスト試験2020年度 10月試験 午前II11/センサ・制御 / クロック生成

PLLのブロック図。入力信号がブロックaに入り、その出力が低域通過フィルタを通ってブロックcを経て出力信号となる。cの出力の一部がブロックbにフィードバックされ、bの出力がaへの入力(入力信号と合わせて)に戻る構成。
PLLのブロック図。入力信号がブロックaに入り、その出力が低域通過フィルタを通ってブロックcを経て出力信号となる。cの出力の一部がブロックbにフィードバックされ、bの出力がaへの入力(入力信号と合わせて)に戻る構成。
abc
位相比較器電圧制御発振器分周器
位相比較器分周器電圧制御発振器
電圧制御発振器位相比較器分周器
電圧制御発振器分周器位相比較器

選択肢

正解と解説

正解: a: 位相比較器、b: 分周器、c: 電圧制御発振器

PLLは、入力信号と帰還信号の位相差を位相比較器で検出し、その誤差をフィルタで平滑して電圧制御発振器の発振周波数を制御する閉ループである。出力の一部を分周器を通して位相比較器へ戻すことで、入力周波数の整数倍の安定した出力が得られる。したがってaが位相比較器、帰還経路のbが分周器、フィルタの後段cが電圧制御発振器となる。

選択肢ごとの解説

出典:令和2年度 10月試験 エンベデッドシステムスペシャリスト試験 午前II 問11(IPA)

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最終更新:2026-08-25/解説・選択肢ごとの解説は資格暗記が独自に作成しています。問題文と選択肢の出典は上記のとおりです。